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    Recruiting

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    高級(jí)模擬電路設(shè)計(jì)工程師-CIS讀出電子學(xué)

    Release time:2021-07-20Pageviews:3632 Second-rate

    崗位職責(zé):

          1.負(fù)責(zé)CMOS圖像傳感器PGAADCCDS電路設(shè)計(jì)。
          2.
    負(fù)責(zé)模擬電路前端、后端設(shè)計(jì)和仿真,以及DRCLVS流程。

     

    任職要求:

          1.211高校(全階段)碩士以上學(xué)歷,微電子相關(guān)專(zhuān)業(yè)。

          2.熟悉CIS原理,熟悉CIS中常用ADC結(jié)構(gòu),有ADC設(shè)計(jì)經(jīng)驗(yàn)。

          3.了解CISCDS等基本原理和設(shè)計(jì)方法,有低噪聲電路和數(shù)模混合電路設(shè)計(jì)經(jīng)驗(yàn)。

          4.熟悉ASIC設(shè)計(jì)流程,包括原理圖設(shè)計(jì)、前仿真、版圖設(shè)計(jì)、后仿真等。

          5.至少參與1次成功流片。

          6.良好的學(xué)習(xí)能力、邏輯思維能力、溝通協(xié)調(diào)能力和抗壓能力。

          7.良好的團(tuán)隊(duì)合作精神和創(chuàng)新精神。

          8.務(wù)實(shí)、嚴(yán)謹(jǐn)、肯鉆研。


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